Texas Instruments Convertitore analogico-digitale (ADC) a 14 bit ADC34J4x
Il convertitore da analogico a digitale (ADC) a 14 bit ADC34J4x Texas Instruments è un convertitore da analogico a digitale (ADC) ad alta linearità, potenza ultrabassa, quattro canali, 14 bit, da 50 MSPS a 160 MSPS. I dispositivi sono progettati espressamente per supportare gli intensi segnali ad alta frequenza in ingresso su un ampio intervallo dinamico. Un ripartitore di ingresso di clock consente maggiore flessibilità di progettazione dell'architettura del clock di sistema mentre l'ingresso SYSREF consente la sincronizzazione dell'intero sistema. La famiglia ADC34J4x supporta le itnerfacce JESD204B e logica della modalità corrente seriale (CML) al fine di ridurre il numero di linee di interfaccia e quindi consentire un'elevata densità di integrazione del sistema. L'interfaccia JESD204B è un'interfaccia seriale, laddove i dati di ciascun ADC sono serializzati ed emessi solo tramite un doppino differenziale. Un circuito ad aggancio di fase (PLL) interno moltiplica il clock di campionamento ADC in entrata per 20 per derivare il clock di bit che viene usato per serializzare i dati a 14 bit da ciascun canale. I dispositivi ADC34J4x supportano la sottoclasse 1 con velocità di interfaccia fino a 3,2 Gbps.
The Texas Instruments ADC34J4x family supports serial current-mode logic (CML) and JESD204B interfaces in order to reduce the number of interface lines, thus allowing high system integration density. The JESD204B interface is a serial interface, where the data of each ADC is serialized and output over only one differential pair. An internal phase-locked loop (PLL) multiplies the incoming ADC sampling clock by 20 to derive the bit clock that is used to serialize the 14-bit data from each channel. The ADC34J4x devices support subclass 1 with interface speeds up to 3.2Gbps.
Caratteristiche
- Quad channel
- 14-Bit resolution
- Single 1.8V supply
- Flexible input clock buffer with divide-by-1, -2, -4
- SNR = 72dBFS, SFDR = 86dBc at fIN = 70MHz
- Ultra-low power consumption
- 203mW/Ch at 160MSPS
- 105dB channel isolation
- Internal dither
- JESD204B serial interface
- Supports subclass 0, 1, 2
- Supports one lane per ADC up to 160MSPS
- Support for multi-chip synchronization
- Pin-to-pin compatible with 12-bit version
- VQFN-48 (7mm × 7mm) package
Applicazioni
- Multi-carrier, multi-mode cellular base stations
- Radar and smart antenna arrays
- Munitions guidance
- Motor control feedback
- Network and vector analyzers
- Communications test equipment
- Nondestructive testing
- Microwave receivers
- Software-Defined Radios (SDRs)
- Quadrature and diversity radio receivers
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