SN65LVDS301ZXHR

Texas Instruments
595-SN65LVDS301ZXHR
SN65LVDS301ZXHR

Produttore:

Descrizione:
Serializzatori e deserializzatori - Serdes Programmable 27-bit display serial inter A 595-SN65LVDS301ZXH

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Prezzi (EUR)

Qtà Prezzo Unitario
Prezzo esteso
Nastro tagliato / MouseReel™
4,16 € 4,16 €
3,16 € 31,60 €
2,92 € 73,00 €
2,64 € 264,00 €
2,51 € 627,50 €
2,43 € 1.215,00 €
2,37 € 2.370,00 €
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2,21 € 5.525,00 €
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Produttore Codice prodotto:
Imballaggio:
Tray
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Min:
1

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Texas Instruments SN65LVDS301ZXH
Texas Instruments
CI di interfaccia LVDS Programmable 27-bit display serial inter A 595-SN65LVDS301ZXHR

Attributo del prodotto Valore dell'attributo Seleziona attributo
Texas Instruments
Categoria prodotto: Serializzatori e deserializzatori - Serdes
RoHS::  
Serializer
1.755 Gb/s
LVDS
CMOS
27 Output
1.95 V
1.65 V
- 40 C
+ 85 C
SMD/SMT
NFBGA-80
Reel
Cut Tape
MouseReel
Marchio: Texas Instruments
Kit di sviluppo: SN65LVDS301 IBIS
Sensibili all’umidità: Yes
Corrente di alimentazione operativa: 200 nA
Tensione di alimentazione di lavoro: 1.8 V
Pd - Dissipazione di potenza: 44.5 mW
Prodotto: Serializers
Tipo di prodotto: Serializers & Deserializers - Serdes
Serie: SN65LVDS301
Quantità colli di fabbrica: 2500
Sottocategoria: Interface ICs
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Attributi selezionati: 0

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USHTS:
8542390090
ECCN:
EAR99

Trasmettitore da parallelo a seriale a 27 bit SN65LVDS301

Il dispositivo SN65LVDS301 di Texas Instruments, trasmettitore parallelo-seriale programmabile a 27 bit, converte 27 ingressi di dati paralleli in 1, 2 o 3 uscite seriali con segnalazione differenziale a bassa tensione (SubLVDS). Carica un registro a scorrimento con 24 bit di pixel e tre bit di controllo dall'interfaccia di ingresso CMOS parallela. Oltre ai 27 bit di dati, il dispositivo aggiunge un bit di parità e due bit riservati in una parola di dati di 30 bit. Il clock del pixel (PCLK) inserisce ogni parola nel dispositivo. Il bit di parità (parità dispari) consente al ricevitore di rilevare gli errori a un solo bit. Il registro a scorrimento seriale viene caricato a 30, 15 o 10 volte la velocità dei dati del pixel clock, a seconda del numero di collegamenti seriali utilizzati. Una copia del clock del pixel viene emessa come uscita differenziale separata.