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BittWare Scheda acceleratrice FPGA 520N-MX

La scheda acceleratore FPGA 520N-MX di BittWare presenta l’FPGA Stratix 10 MX2100 di Intel® con memoria HBM2 integrata. La scheda di accelerazione FPGA 520N-MX offre una HBM2 con 16 GB fino a 512GB/s, consentendo l’accelerazione delle applicazioni legate alla memoria.

La scheda QSFP28s 100 G 520N-MX BittWare è ideale per il clustering e i connettori OCuLink consentono l'espansione. Il dispositivo supporta i flussi di strumenti basati su HDL tradizionale e C, C++ e OpenCL ad astrazione superiore. Il 520N-MX presenta un controller di gestione della scheda (BMC) per il monitoraggio e il controllo avanzato del sistema, che semplifica l'integrazione e la gestione della piattaforma.

Caratteristiche

  • Intel Stratix 10 MX2100
  • 16 GB HBM2 fino a 512 GB/s
  • BSP OpenCL ottimizzato per BittWare
  • Kit di sviluppo software (SDK) openCL Intel FPGA
    • Supporto OpenCL per clienti orientati al software
    • Astrazione per uno sviluppo più rapido
    • Flusso a pulsante per FPGA eseguibile, driver e API
    • Aggiungi core IP HDL ottimizzati a progetti OpenCL come librerie
  • Linguaggio di descrizione hardware (HDL)
    • Supporto VHDL/Verilog tradizionale per clienti orientati all'hardware
    • Hand coding per prestazioni eccellenti
    • Sintesi ad alto livello (HLS) disponibile per uno sviluppo rapido
    • Scheda FPGA progettata per il supporto di core IP Intel standard per Stratix 10

Specifiche

  • FPGA
    • Intel Stratix 10 MX
      • MX2100 in un package F2597
      • DRAM di memoria a larghezza di banda elevata (HBM2) da 16 GByte su chip, 410 GB/s (classe di velocità 2)
      • Classe di velocità del nucleo -2: classe di velocità I/O -2
  • Flash integrata
    • Memoria flash a 2 Gbit per l'avvio FPGA
  • Memoria esterna
    • 2 slot DIMM 288 pin, ciascuno dotato di moduli da 16 GB per impostazione predefinita, ovvero 32 GB totali su scheda (opzioni fino a 256 GB totali)
  • Interfaccia host
    • Interfaccia x16 Gen3 diretta a FPGA, collegata a IP hard PCIe
  • Gabbie QSFP
    • 4 gabbie QSFP28 sul pannello anteriore collegate direttamente a FPGA tramite 16 ricetrasmettitori
    • Clocking a basso jitter programmabile dall'utente che supporta 10/25/40/100 GbE
    • Ogni QSFP28 può essere registrato con clock in modo indipendente
    • Eliminatore di jitter per clock recuperato in rete
    • 2 QSFP28s dispongono di IP hard MAC 100 GbE
  • OCuLink
    • 2 connettori edge (A, B) a 12,5 G per corsia (predefinito); ciascuno supporta il master di ingresso PCIe Gen 3 x8 hard IP, GPIO e PCIe e il clocking di ingresso opzionale
    • 2 connettori interni (C, D) a 25 G per corsia (opzionale); 1 IP hard MAC 100 GbE per OCuLink
  • Controller di gestione scheda
    • Monitoraggio di temperatura/corrente/tensione
    • Sequenziamento e ripristino dell'alimentazione
    • Aggiornamenti sul campo
    • Configurazione e controllo FPGA
    • Configurazione clock
    • Comunicazioni BMC-FPGA a bassa larghezza di banda con collegamento SPI
    • USB 2.0
    • Supporto PLDM
    • Override di tensione
  • Raffreddamento
    • Dissipatore di calore attivo a doppia larghezza (con ventola) - standard
    • Dissipatore di calore passivo a doppia larghezza - opzionale
    • Raffreddamento liquido a doppia larghezza - opzionale
  • Dati elettrici
    • Alimentazione integrata derivata dallo slot PCIe a 12 V e due connettori AUX (uno a 8 pin, uno a 6 pin)
    • La dissipazione di potenza dipende dall'applicazione
    • Consumo energetico tipico massimo 225 W
  • Impegno ambientale
    • Temperatura di funzionamento da +5 °C a +35 °C
  • Qualità
    • Prodotto secondo ISO9001:2015 IPC-A-610-classe III
    • Conforme a RoHS
    • Approvazioni CE, FCC e ICES
  • Fattore di forma
    • Scheda a doppio slot PCIe ad altezza standard
    • 111 mm x 266,7 mm (4,376 “ x 10,5 ”)
  • Strumenti di sviluppo
    • BIST di sviluppo FPGA – autotest integrato per CentOS 7 fornito con codice sorgente (piedinatura, gateware, driver PCIe e applicazione di host test)
    • Flussi di progettazione supportati dallo sviluppo di applicazioni – Intel FPGA OpenCL SDK, Sintesi a alto livello Intel (C/C++) e Quartus Prime Pro (HDL, Verilog, VHDL, ecc.)

Contenuto del kit

  • Scheda FPGA 520N-MX
  • Cavo USB (accesso pannello anteriore)
  • Test automatico integrato (BIST)
  • Package di supporto scheda (BSP) HPC OpenCL
  • Accesso di 1 anno al sito di sviluppo online
  • Garanzia di 1 anno sull'hardware

Video

Schema a blocchi

Schema a blocchi - BittWare Scheda acceleratrice FPGA 520N-MX

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Pubblicato: 2020-06-11 | Aggiornato: 2025-06-24