TMS320C5532AZAY10

Texas Instruments
595-S320C5532AZAY10
TMS320C5532AZAY10

Produttore:

Descrizione:
Processori e controllori di segnali digitali - DSP, DSC Low power C55x fixed point DSP- up to 10

Scheda dati:
Modello ECAD:
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2,60 € 2.912,00 €
2,53 € 6.476,80 €

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Texas Instruments
Categoria prodotto: Processori e controllori di segnali digitali - DSP, DSC
RoHS::  
DSPs
C55x
1 Core
100 MHz
BGA-144
64 kB
64 kB
1.3 V
TMS320C5532
SMD/SMT
- 10 C
+ 70 C
Tray
Marchio: Texas Instruments
Dimensioni ROM dati: 128 kB
Kit di sviluppo: TMDX5535EZDSP
Tensione I/O: 1.8 V to 3.3 V
Tipo di istruzione: Fixed Point
Tipo di interfaccia: I2C, I2S, SPI, UART
Sensibili all’umidità: Yes
Numero di timer/contatori: 3 x 32 bit
Tipo di prodotto: DSP - Digital Signal Processors & Controllers
Quantità colli di fabbrica: 160
Sottocategoria: Embedded Processors & Controllers
Tensione di alimentazione - Max.: 1.43 V
Tensione di alimentazione - Min.: 1.24 V
Sistema di controllo con timer: Watchdog Timer
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TARIC:
8542319000
CNHTS:
8542319090
CAHTS:
8542310000
USHTS:
8542310035
ECCN:
3A991.a.2

Processors

Texas Instruments Processors provide a comprehensive portfolio, proven software, and worldwide support, enabling industry-leading automotive and industrial solutions. TI is dedicated to advancing and optimizing today’s processors to meet tomorrow’s intelligence, performance, and cost requirements in automotive and industrial applications. Scalable hardware and software platforms with common code allow designers to seamlessly reuse and migrate across devices to protect future investment.

TMS320C553x Fixed-Point DSPs

Texas Instruments TMS320C553x Fixed-Point Digital Signal Processors (DSPs) are designed for low-power applications and based on the TMS320C55x DSPC55x DSP generation CPU processor core. The architecture achieves high performance and low power through increased parallelism and total focus on power savings. TI TMS320C553x DSPs support an internal bus structure composed of one program bus, one 32-bit data read bus and two 16-bit data read buses, two 16-bit data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to four 16-bit data reads and two 16-bit data writes in a single cycle.

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