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LS1020AXN7HNB

Name: NXP LS1020AXN7HNB
Brand: NXP Semiconductors
SKU: 841-LS1020AXN7HNB
Price: 50.01 EUR
Availability: InStock

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N. Mouser:

841-LS1020AXN7HNB

N. produttore:

LS1020AXN7HNB

Produttore:

NXP Semiconductors

Descrizione:

Microprocessori - MPU Layerscape 32-bit Arm Cortex-A7, Dual-core, 800MHz, -40 to 105C, Security disabled

Scheda dati:

LS1020AXN7HNB Scheda dati (PDF)

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Prezzi (EUR)

Qtà	Prezzo Unitario	Prezzo esteso
	50,01 €	50,01 €
	41,25 €	412,50 €
	35,88 €	897,00 €

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Attributo del prodotto	Valore dell'attributo	Seleziona attributo
Produttore:	NXP
Categoria prodotto:	Microprocessori - MPU
Limitazioni per la spedizione:	Potrebbe essere necessaria della documentazione aggiuntiva per esportare questo prodotto dagli Stati Uniti.
RoHS::
Nucleo:	ARM Cortex A7
Numero di nuclei:	2 Core
Larghezza bus dati:	32 bit
Frequenza di clock massima:	800 MHz
Package/involucro:	FCPBGA-525
L1 Memoria istruzioni cache:	32 kB
L1 Memoria dati cache:	32 kB
Tensione di alimentazione di lavoro:	1 V
Serie:	LS1020A
Stile di montaggio:	SMD/SMT
Temperatura di lavoro minima:	- 40 C
Temperatura di lavoro massima:	+ 105 C
Confezione:	Tray
Marchio:	NXP Semiconductors
Dimensioni RAM dati:	128 kB
Tipo di istruzione:	Floating Point
Tipo di interfaccia:	Audio, Ethernet, PCI-e, Serial, USB
L2 Memoria istruzioni/dati cache:	512 kB
Tipo di memoria:	DDR3L / DDR4 SDRAM
Sensibili all’umidità:	Yes
Numero di I/O:	109 I/O
Numero di timer/contatori:	8 Timer
Serie processore:	QorIQ Layerscape LS1020A
Tipo di prodotto:	Microprocessors - MPU
Quantità colli di fabbrica:	84
Sottocategoria:	Microprocessors - MPU
Nome commerciale:	QorIQ
Sistema di controllo con timer:	Watchdog Timer
Alias n. parte:	935312943557
Peso unità:	1 g

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Scheda dati

LS1020AXN7HNB Scheda dati (PDF)

TARIC:: 8542319000
CNHTS:: 8542319091
CAHTS:: 8542310000
USHTS:: 8542310030
KRHTS:: 8542311000
MXHTS:: 8542310302
ECCN:: 3A991.a.1

Layerscape Architecture

NXP Layerscape Architecture is the underlying system architecture of the QorIQ® LS series processors. The architecture enables next-generation networks with up to 100Gb/s performance and enhanced packet processing capabilities. Design effort is simplified with a standard, open programming model and a software-aware architecture framework. This design enables customers to fully exploit the underlying hardware for maximum optimization, with the capability to easily adapt to network changes for real-time soft control over the network. A uniform hardware and software model provides the compatibility and scalability required for designing end-to-end networking equipment from home-to carrier-class products. The core-agnostic architecture incorporates the optimum core for the given application: Arm® cores or Power Architecture® cores.